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SSE_551593
設計
(業種:IT関連)
駅近のシステム開発会社にて画像処理FPGAのシステム開発のお仕事です。高時給で残業も多めなのでしっかり稼ぎたい方にオススメ!
■画像処理FPGAの設計や開発
【登録に際してオフィスにお越しいただく必要はございません! WEBとお電話にて登録完了となります!】
【月収例】
26万4000円=時給1650円×160時間(残業代別途)
【こんなスキルや経験のある方を歓迎します!】
Verilog-HDL、VHDL。電気知識。
【活かせる経験】
Verilog
HDL
必要スキル・使用ツール
Verilog HDL、VHDL
宮城県仙台市青葉区
最寄駅:東北本線 仙台駅 徒歩10分
時給1,650円
~
(交通費別途支給 ※当社規定あり)
即日~ 長期
勤務曜日:月火水木金
09:00~18:00
残業(30時間程度)
土日
ロッカーあり。
【職種】
電気・電子系:基本設計、詳細設計・回路設計、CADオペレーション、設計補助、関連業務
【派遣先】
ソフトウェア会社でのお仕事です。
【担当製品】
ハードウェア設計
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