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SSE_626474
設計
(業種:サービス関連)
<西新駅*徒歩10分> 電気・電子の経験がある方歓迎です!お気軽にお問い合わせください。
【LSI/FPGA開発業務】
・FPGAの回路設計
・各種ツールを利用しての評価業務
・ドキュメント作成業務
■就業場所:福岡県内(弊社お客様先での常駐、在宅勤務での対応の可能性あり)
【登録に際してオフィスにお越しいただく必要はございません! WEBとお電話にて登録完了となります!】
【月収例】
51万2000円=時給3200円×160時間(残業代別途)
【こんなスキルや経験のある方を歓迎します!】
・Verilog-HDLでの論理設計/検証
経験:5年以上
・Linux環境での論理設計/検証業務経験
【活かせる経験】
Verilog
HDL、Linux、論理回路図の読み書きなど
必要スキル・使用ツール
Verilog HDL、LinuxSVA、SystemVerilog、Virtuoso
福岡県福岡市早良区
最寄駅:福岡市営地下鉄空港線 西新駅 徒歩10分
時給3,200円
~
(交通費別途支給 ※当社規定あり)
即日~ 長期
勤務曜日:月火水木金
09:00~18:00
残業(20時間程度)
土日祝
【職種】
電気・電子系:詳細設計・回路設計、シミュレーション、評価・テスト
【派遣先】
総合設計エンジニアリング会社
【担当製品】
半導体
SSE_554390
設計
(業種:サービス関連)
<西新駅*徒歩10分> 電気・電子の経験がある方歓迎です!お気軽にお問い合わせください。
【LSI/FPGA開発業務】
・FPGAの回路設計
・各種ツールを利用しての評価業務
・ドキュメント作成業務
■就業場所:福岡県内(弊社お客様先での常駐、在宅勤務での対応の可能性あり)
【登録に際してオフィスにお越しいただく必要はございません! WEBとお電話にて登録完了となります!】
【月収例】
32万円=時給2000円×160時間(残業代別途)
【こんなスキルや経験のある方を歓迎します!】
・Verilog-HDLでの論理設計/検証
経験:5年以上
・Linux環境での論理設計/検証業務経験
【活かせる経験】
Verilog
HDL、Linux、論理回路図の読み書きなど
必要スキル・使用ツール
Verilog HDL、LinuxSVA、SystemVerilog、Virtuoso
福岡県福岡市早良区
最寄駅:福岡市営地下鉄空港線 西新駅 徒歩10分
時給2,000円
~
(交通費別途支給 ※当社規定あり)
即日~ 長期
勤務曜日:月火水木金
09:00~18:00
残業(20時間程度)
土日祝
【職種】
電気・電子系:詳細設計・回路設計、シミュレーション、評価・テスト
【派遣先】
総合設計エンジニアリング会社
【担当製品】
半導体
2件中
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